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電子線路設(shè)計、實驗、測試（第3版） 
定 價：39.8 元
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本書是普通高等教育“十五”國家級規(guī)劃教材，是在第二版的基礎(chǔ)修訂完成的。第二版是“九五”四家級重點教材，并于2002年獲全國普通高等學(xué)校優(yōu)秀教材二等獎。
全書共11章。第1～4章為基礎(chǔ)性實驗。第1章介紹了測量誤差的基本理論和實驗數(shù)據(jù)處理的基本方法；第2章介紹了晶體二極管、三極管、MOS場效應(yīng)管及集成運算放大器等器件的性能參數(shù)的測試方法和基本應(yīng)用電路；第3章介紹了集成邏輯門、集成觸發(fā)器、集成電路555及中小規(guī)模的組合邏輯電路和時序邏輯電路等的性能參數(shù)、邏輯功能測試與基本應(yīng)用電路的設(shè)計方法。第4章介紹了OrCAD9.2版教學(xué)軟件的操作方法及12個低頻電路、數(shù)字邏輯電路、高頻電路、模/數(shù)混合電路等的仿真示例。第5～7章分別為低頻電路、高頻電路、數(shù)字邏輯電路等的設(shè)計性實驗，其中低頻、高頻電路的設(shè)計課題15個，數(shù)字電路設(shè)計課題7個。這些設(shè)計課題中，介紹了以定量估算和實驗為基礎(chǔ)的電子線路的傳統(tǒng)設(shè)計與方法與測試技術(shù)，旨在加強(qiáng)對學(xué)生進(jìn)行工程設(shè)計的基礎(chǔ)訓(xùn)練。第8章硬件描述語言，介紹了Verilog HDL的基本語法規(guī)則、程序的基本結(jié)構(gòu)、和門級、行為級建模的方式，給出了12個程序設(shè)計示例。第9章介紹了兩種可編程邏輯器件，即CPLD和FPGA的基本結(jié)構(gòu)和編程方法，給出了開發(fā)MAX+PLUSⅡ下實現(xiàn)工程項目設(shè)計的操作流程和芯片下載的示例。通過這兩章的學(xué)習(xí)，可掌握可編程邏輯器件的EDA設(shè)計方法和芯片下載。第10章介紹了4個綜合性電子線路系統(tǒng)設(shè)計的示例。第11章介紹了通用電子儀器的應(yīng)用技術(shù)。 本書可作為高等學(xué)校電工、電子、通信類專業(yè)本、�？茖W(xué)生電子技術(shù)與電子線路實驗課或課程設(shè)計教材，亦可供從事電子設(shè)計工作的工程技術(shù)人員參考。
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