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CMOS模擬集成電路版圖設(shè)計與驗證——基于Cadence Virtuoso與Mentor Calibre

CMOS模擬集成電路版圖設(shè)計與驗證——基于Cadence Virtuoso與Mentor Calibre

定  價:48 元

        

  • 作者:尹飛飛等
  • 出版時間:2016/8/1
  • ISBN:9787121298073
  • 出 版 社:電子工業(yè)出版社
  • 中圖法分類:TN432.02 
  • 頁碼:272
  • 紙張:膠紙版
  • 版次:1
  • 開本:16K
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    本書依托Cadence Virtuoso版圖設(shè)計工具與Mentor Calibre版圖驗證工具,采取循序漸進的方式,介紹利用Cadence Virtuoso與Mentor Calibre進行CMOS模擬集成電路版圖設(shè)計、驗證的基礎(chǔ)知識和方法,內(nèi)容涵蓋了CMOS模擬集成電路版圖基礎(chǔ)知識,Cadence Virtuoso與Mentor Calibre的基本概況、操作界面和使用方法,CMOS模擬集成電路從設(shè)計到流片的完整流程,同時又分章介紹了利用Cadence Virtuoso版圖設(shè)計工具、Mentor Calibre版圖驗證工具及Synopsys Hspice電路仿真工具進行CMOS電路版圖設(shè)計與驗證、后仿真的實例,包括運算放大器、帶隙基準(zhǔn)源、低壓差線性穩(wěn)壓源、比較器和輸入/輸出單元。
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